电子加法器（Electronic adder）是用于执行加法运算的数字电路部件，构成微处理器算术逻辑单元的基础，可处理二进制数运算及地址计算。其主流实现形式包含半加器和全加器，其中全加器通过接收低位进位信号并输出本位和高位进位，可级联形成多位加法器。
波纹进位加法器存在逐级延迟问题，而超前进位加法器采用进位产生信号（Gi=Ai*Bi）和进位传递信号（Pi=Ai+Bi）进行并行计算，通过递归展开进位表达式消除串行延迟。多位加法器通常采用分段逻辑划分设计，例如将64位全加器划分为四个16位超前进位模块 。标准芯片如74283采用超前进位结构，32位加法器可通过组联4位超前进位部件实现，其中每个模块包含进位产生信号Gm和进位传递信号Pm 。
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